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MPC8555E CDS开发板硬件配置与调试指南：勘误文档深度解析

news 2026/6/14 12:05:57

1. 项目概述与核心价值

如果你手头正巧有一块飞思卡尔（Freescale，现为NXP）的MPC8555E CDS开发板，并且正在对照那份厚厚的参考手册进行硬件调试或软件移植，那么这份勘误文档就是你的“避坑圣经”。我最近在为一个老旧的网络设备项目做硬件维护，核心平台就是基于MPC8555E的CDS开发板。在翻箱倒柜找出原理图准备进行功能扩展时，我发现手头的参考手册（Rev. 0）和实际的硬件（尤其是Rev. 1.3版本的载板）对不上号，一些关键配置怎么调都无法让以太网端口正常工作。经过一番折腾，最终找到了这份发布于2006年11月的官方勘误文档（MPC8555CDSx3RMAD, Rev. 0.2），所有问题才迎刃而开。

这份勘误的价值，远不止是修正几个印刷错误。它清晰地记录了CDS开发板从Configuration 1（配置1）到Configuration 2（配置2）的硬件演进，特别是载板从Rev. 1.2升级到Rev. 1.3所带来的根本性变化。对于嵌入式硬件工程师和底层驱动开发者而言，它解决了三个核心痛点：第一，明确了不同硬件版本间的关键差异，防止错误配置导致硬件损坏或功能异常；第二，修正了原始手册中含糊或错误的描述，如时钟频率、开关设置和PHY芯片型号，为精准的硬件初始化提供了依据；第三，通过更新BOM（物料清单）和原理图，为后续的硬件维修、物料采购或设计参考提供了准确的版本信息。无论是进行全新的板卡启动、故障排查，还是基于此平台进行二次开发，吃透这份勘误都是确保工作顺利进行的第一步。

2. 硬件配置解析：从Configuration 1到Configuration 2

2.1 两种配置的构成与定位

MPC8555E CDS开发板并非一个固定不变的硬件实体，飞思卡尔为其定义了两套主要的硬件配置，这在勘误文档的1.3节有明确说明。理解这两者的区别，是正确使用开发板的前提。

Configuration 1（配置1）是一个相对完整的“三件套”系统：

  • Arcadia主板： Rev. 3.1，作为系统背板和主要接口提供者。
  • 载板（Carrier Card）： Rev. 1.2，承载MPC8555E处理器子卡并提供基础外设。
  • 处理器子卡（CPU Card）： Rev. 1.1，核心是MPC8555E Power Architecture处理器。
  • I/O卡（I/O Card）： Rev. 1.1，提供额外的扩展接口。

这种配置更像一个功能齐全的评估系统，I/O卡的存在增加了灵活性，但也引入了更多的连接点和潜在的信号完整性考量。文档特别指出，在Configuration 1下，I/O卡上的第四个以太网端口（Port #4）是不工作的。这是一个非常重要的限制，如果你在调试中试图启用该端口，只会徒劳无功。

Configuration 2（配置2）则代表了硬件设计的迭代和集成化：

  • Arcadia主板： 仍为Rev. 3.1。
  • 载板（Carrier Card）： 升级至Rev. 1.3，这是最关键的变更。
  • 处理器子卡（CPU Card）： 仍为Rev. 1.1。
  • I/O卡：被取消。其功能（除USB端口外）被集成到了新的载板上。

Configuration 2的设计思路是精简结构、提高可靠性。通过将I/O卡的功能集成到载板，减少了板间连接器，降低了接触不良的风险，信号路径也更短、更可控。同时，它解决了Configuration 1中以太网端口4失效的问题，所有四个端口均可正常工作。

实操心得：如何快速识别你的硬件版本？最直接的方法是查看载板上的丝印。通常会在PCB的空白处标注“Carrier Rev 1.2”或“Carrier Rev 1.3”。如果没有明确丝印，可以通过观察以太网PHY芯片来辨别：如果载板上使用的是Cicada CS8204四端口PHY，那么很可能是Rev. 1.2（Configuration 1）；如果换成了Marvell 88E1145，则一定是Rev. 1.3（Configuration 2）。这个区别直接影响后续的驱动配置和网络功能调试。

2.2 核心变更项深度解读

勘误文档虽然条目繁多，但核心的硬件变更可以归纳为以下几类，理解这些是硬件调试的基础：

1. 以太网子系统重构（最关键的变更）这是Configuration 1和2之间最本质的区别，直接影响了网络功能的可用性和性能。

  • Configuration 1 (Rev. 1.2载板):
    • PHY芯片： 使用Cicada CS8204四端口PHY。
    • 端口分布： 两个端口在载板上，两个端口在I/O卡上。
    • 接口模式： 仅支持标准的MII/GMII接口。文档明确指出，TBI、RTBI、RMII和RGMII模式均不支持。这意味着你在配置Linux内核或U-Boot中的网络控制器时，只能选择MII或GMII模式。
    • 功能限制： I/O卡上的以太网端口4（Port #4）不可用。这是一个硬件设计上的限制，并非软件问题。
  • Configuration 2 (Rev. 1.3载板):
    • PHY芯片： 更换为Marvell 88E1145四端口PHY。这是一款更常见、支持更广泛的千兆以太网PHY。
    • 端口分布： 所有四个端口均在载板上。
    • 接口模式： 端口1和2支持MII/GMII，而端口3和4支持RGMII（Reduced Gigabit Media Independent Interface）。RGMII使用更少的信号线（仅需12根，而GMII需要24根），能有效节省PCB布线空间，但对时序要求更严格。
    • 功能： 所有四个端口均支持10/100/1000 Mbps速率，且全部可用。

2. 时钟系统修正原始手册中多处将PCI时钟描述为“33-66 MHz”，勘误统一修正为“33/66 MHz”。这个“/”符号的修正看似微小，实则关键。它明确了这是一个可选择的时钟频率，而非一个范围。在硬件上，通常通过某个跳线或开关（如载板上的SW1(3)在Configuration 2中被定义为PCI CLK SEL）或通过PCI设备的M66EN信号来动态选择33 MHz或66 MHz模式。软件（如PCI控制器驱动）需要正确读取此配置，以初始化正确的时钟域。

3. 电源与物料更新

  • DC-DC转换器： Rev. 1.3载板将 obsolete（已停产）的RC5051M DC-DC转换器更换为Belfuse SRDB-30B1AH，用于将5V转换为2.5V。这属于常规的物料更新，旨在保证供应链和可靠性。
  • RoHS合规： 整个BOM（物料清单）更新为使用符合RoHS（有害物质限制）标准的元器件编号。这对于2006年后的电子产品生产和出口是强制性要求。
  • 连接器： 由于找不到符合RoHS标准的替代品，移除了I/O卡连接器J7（在Rev. 1.2a原理图中存在）。这从侧面印证了Configuration 2取消独立I/O卡的设计决策。

4. 开关配置与功能更新载板和Arcadia板上的DIP开关设置是硬件初始化的关键。勘误更新了多个开关位的定义：

  • 载板SW1(3)： 在Configuration 2中，此开关位被重新定义为PCI CLK SEL，并且必须设置为1。这与上述时钟选择直接相关。
  • 载板SW2(6)： 在Configuration 2中，此开关位用于PCI模式选择（PCI = 1, PCI-X = 0）。PCI-X是PCI的扩展，支持更高频率和带宽，需要硬件和软件同时支持。
  • Arcadia板开关： 多个开关位的功能被重新定义或标注为“用户定义”、“保留”或“可选功能”。例如，SW3的某些位用于控制RealTek 8139网卡的使能、PCI总线中断的连接方式以及PrPMC模块的配置。这些细节在进行特定功能调试（如禁用板载设备、隔离PCI总线段）时至关重要。

3. 硬件配置实操与启动指南

3.1 上电前检查与硬件组装

在给开发板通电之前，进行一次彻底的硬件检查可以避免许多低级错误。根据勘误文档2.1和2.2节的指引，并结合我的经验，步骤如下：

  1. 确认配置组合： 根据��的硬件，明确你拥有的是Configuration 1还是Configuration 2。重点检查载板版本和有无I/O卡。
  2. 检查电源： 确认电源适配器的电压、电流和极性符合开发板要求（通常是+12V）。使用万用表测量电源接口，确保无短路。
  3. 安装与连接：
    • 将处理器子卡牢固地插入载板的对应插槽，确保所有连接器引脚对齐并锁紧。
    • 对于Configuration 1，将I/O卡安装到载板上。
    • 将载板（或载板+I/O卡组合）安装到Arcadia主板上。
    • 连接串口线（通常是DB9到USB转串口线）到载板的调试串口。这是后续查看U-Boot和内核日志的生命线。
    • 连接网线到你需要使用的以太网端口。注意：如果是Configuration 1，请避开I/O卡上的Port #4。
    • 最后连接电源线，但先不要打开电源开关。

3.2 开关与跳线设置

这是硬件配置中最容易出错的一环。你必须根据你的硬件版本，对照勘误后的表格进行设置。这里以Configuration 2（Rev. 1.3载板）为例，说明几个关键点：

  • 载板DIP开关 (SW1, SW2, SW3, SW4)： 参考勘误后的表2-2（针对Configuration 1）及其注释。
    • SW1(3)： 必须设置为1（PCI CLK SEL）。这个位置在旧手册中可能是“Reserved”（保留），现在有了明确功能。
    • SW2(6)： 根据你需要的PCI模式设置。如果使用标准PCI设备，设置为1（PCI模式）；如果使用PCI-X设备，设置为0（PCI-X模式）。
    • 其他开关位（如SW1(2) Synchronizer）通常按默认值（文档中标注的1或0）设置即可，除非你有特殊需求。
  • Arcadia板DIP开关： 参考勘误后的表2-3。这里有很多高级功能控制位。
    • SW3(5) - ENET_DIS*： 如果你想禁用板载的RealTek 8139以太网控制器（例如，避免与MPC8555E的TSEC冲突），将此位设置为1。
    • SW3(6) - PCI_INT_BRIDGE*： 控制PCIA和PCIB中断线的连接方式。通常默认（0）即可，即中断线直接相连（wire-OR）。如果遇到PCI中断冲突问题，可以尝试设置为1进行隔离。
    • SW3(7) - PRPMC_IDSELEN*： 与PrPMC（Processor PMC）模块相关。如果PrPMC模块不允许其自身IDSEL在被作为PCI主机时被置位，则将此开关设置为1来禁用IDSEL。

注意事项：开关状态的读取DIP开关上通常标有“ON”和“OFF”方向。通常，“ON”代表逻辑“1”或闭合，“OFF”代表逻辑“0”或断开。但最可靠的方法是使用万用表通断档测量：开关拨到一侧，测量对应两个引脚是否导通。导通即为“1”（闭合），不导通即为“0”（断开）。在设置前后，最好拍照留存，以便后续排查。

3.3 上电与U-Boot引导

完成硬件连接和开关设置后，可以上电。打开串口终端软件（如Putty、Minicom、SecureCRT），设置波特率为115200，数据位8，停止位1，无奇偶校验，无流控。

上电后，你应该在串口终端看到类似以下的U-Boot启动信息（取自勘误文档2.3节更新后的内容）：

U-Boot 1.1.3 (FSL Development) (Oct 27 2006 - 10:43:18) CPU: 8555, Version: 1.1, (0x80790011) Core: E500, Version: 2.0, (0x80200020) Clock Configuration: CPU: 833 MHz, CCB: 333 MHz, DDR: 166 MHz, LBC: 83 MHz L1: D-cache 32 kB enabled I-cache 32 kB enabled Board: CDS Version 0x13 CPU Board Revision 0.0 (0x0000) PCI1: 32 bit, 33 MHz, sync PCI2: 32 bit, 66 MHz, async I2C: ready DRAM: Initializing SDRAM: 64 MB DDR: 256 MB FLASH: 16 MB L2 cache 256KB: enabled In: serial Out: serial Err: serial Net: TSEC0: PHY is Marvell 88E1145 (1410cd4) TSEC1: PHY is Marvell 88E1145 (1410cd4) TSEC0, TSEC1 The IP address of the board is currently set to 169.254.113.58 The MAC address is 00:04:9F:00:28:C8 If they don't match your network environment, please change them in U-Boot and kernel manually. Hit any key to stop autoboot: 0 =>

关键信息解读：

  • Board: CDS Version 0x13： 这行信息很重要，0x13可能对应特定的硬件配置版本。
  • PCI1: 32 bit, 33 MHz, sync和PCI2: 32 bit, 66 MHz, async： 这显示了两个PCI控制器的配置，与硬件开关设置相符。
  • Net: TSEC0: PHY is Marvell 88E1145：这是识别Configuration 2（Rev. 1.3载板）的铁证！U-Boot正确识别了Marvell PHY。如果是Configuration 1，这里显示的应该是Cicada PHY。
  • 默认IP地址是169.254.113.58，这是一个链路本地地址。你需要根据你的网络环境，在U-Boot中使用setenv ipaddr和setenv serverip命令修改IP地址，或者在内核启动后修改。

如果串口没有任何输出，请按顺序检查：电源指示灯是否亮起、串口线连接是否正确、终端参数设置是否匹配、开发板上的调试串口是否确实是当前连接的这个。

4. 关键功能模块配置详解

4.1 以太网功能配置与调试

以太网是开发板最常用的功能之一，其配置因硬件版本而异。

对于Configuration 1 (Cicada CS8204 PHY):

  1. PHY地址： PHY地址不是固定的，需要通过硬件配置（如上下拉电阻）来设置。你需要查阅原理图或勘误文档中的表3-16来确定每个端口对应的PHY地址。在Linux驱动中，需要在设备树（Device Tree）或平台数据中正确指定这些地址。
  2. 接口模式： 在设备树中，必须将TSEC（Three-Speed Ethernet Controller）节点的interface-mode属性设置为"gmii"或"mii"。切勿设置为"rgmii"、"rmii"、"tbi"或"rtbi"，因为硬件不支持。
  3. 端口可用性： 在软件配置中，只需使能TSEC0、TSEC1和TSEC2（对应载板两个端口和I/O卡上一个可用端口）。TSEC3（对应I/O卡上失效的Port #4）应被禁用或忽略。

对于Configuration 2 (Marvell 88E1145 PHY):

  1. PHY地址： 勘误文档指出“The Ethernet PHY addresses are fixed in Configuration 2”。这意味着地址是硬件设计固定的，通常Marvell 88E1145的四个端口会有连续的固定地址（例如0x0, 0x1, 0x2, 0x3）。你需要在驱动或设备树中使用这些固定地址。
  2. 接口模式： 这是最容易出错的地方。端口1和2（通常对应TSEC0和TSEC1）连接在MPC8555E的GMII/MII接口上，因此设备树中对应的interface-mode应设置为"gmii"。而端口3和4（可能对应TSEC2和TSEC3，具体需查原理图）连接在RGMII接口上，因此对应的interface-mode必须设置为"rgmii"。混合模式配置是Configuration 2的特有情况。
  3. RGMII时序调整： RGMII接口对TX/RX时钟与数据之间的时序要求非常严格。Marvell 88E1145和MPC8555E的TSEC控制器可能都需要在设备树中配置rgmii-delay属性（例如rgmii-txid、rgmii-rxid），来补偿PCB布线造成的延迟，确保数据采样正确。如果网络不稳定或无法连接，这是首要的排查点。

设备树配置示例片段 (Configuration 2 假设)：

// 假设 TSEC0, TSEC1 连接 PHY 端口 0,1，模式为 GMII ethernet@24000 { compatible = "fsl,mpc8555-tsec", "fsl,tsec"; device_type = "network"; model = "TSEC"; ... phy-handle = <&phy0>; phy-connection-type = "gmii"; ... }; // 假设 TSEC2 连接 PHY 端口 2，模式为 RGMII ethernet@25000 { compatible = "fsl,mpc8555-tsec", "fsl,tsec"; device_type = "network"; model = "TSEC"; ... phy-handle = <&phy2>; phy-connection-type = "rgmii"; // RGMII 可能需要延迟配置 // fsl,rgmii-rxid; // 使用RX内部延迟 // fsl,rgmii-txid; // 使用TX内部延迟 ... }; mdio@24520 { #address-cells = <1>; #size-cells = <0>; compatible = "fsl,gianfar-mdio"; ... phy0: ethernet-phy@0 { reg = <0x0>; // PHY 地址 0 compatible = "ethernet-phy-ieee802.3-c22"; marvell,reg-init = <...>; // 可选的Marvell特定配置 }; phy1: ethernet-phy@1 { reg = <0x1>; compatible = "ethernet-phy-ieee802.3-c22"; }; phy2: ethernet-phy@2 { reg = <0x2>; compatible = "ethernet-phy-ieee802.3-c22"; }; // phy3 ... };

4.2 PCI/PCI-X子系统配置

PCI配置主要依赖于硬件开关和正确的时钟。

  1. 时钟选择： 确保载板SW1(3)（Configuration 2）已按前述设置为1。PCI插槽上的设备（如网卡、采集卡）需要与主控制器（MPC8555E）的PCI时钟同步。33 MHz和66 MHz模式对PCB布线长度和信号完整性要求不同，错误的时钟选择会导致设备无法识别或工作不稳定。
  2. 模式选择： 通过载板SW2(6)选择PCI或PCI-X模式。PCI-X是向后兼容的，但如果你插入的是标准PCI设备，而开关设置为PCI-X（0），可能会导致兼容性问题。通常，如果无特殊需求，设置为PCI模式（1）兼容性最好。
  3. 中断路由： 勘误文档5.5.4节更新了PCI插槽的中断映射表。当你在开发PCI设备驱动时，需要清楚设备插在哪个槽位，以及它使用哪个INTx#引脚，从而对应到MPC8555E的哪个中断输入（PCIA1_INT0~INT3）。这个信息对于编写正确的驱动中断处理程序至关重要。
  4. 资源分配： 在Linux下，可以使用lspci -vv命令查看PCI总线上枚举到的所有设备，确认其BAR（Base Address Register）空间、中断号等是否被正确分配。如果设备未出现，首先检查物理连接和开关设置，然后检查U-Boot或内核是否禁用了某些PCI总线或桥接器。

4.3 时钟与复位系统

MPC8555E CDS系统包含多个时钟域，勘误文档3.8节对此进行了澄清：

  1. 系统时钟（SYSCLK）： 提供给MPC8555E核心和内部总线。
  2. 本地总线时钟（LBCLK）： 用于Flash、NVRAM等本地总线设备。
  3. PCI时钟（PCICLK）： 如前所述，为33/66 MHz，用于PCI总线。
  4. 高速时钟（GTX_CLK等）： 用于以太网等高速接口。

在Configuration 2中，时钟结构被更新以更好地支持MPC8555E的SYSCLK和PCICLK信号。此外，为时钟驱动器和振荡器增加了电源引脚滤波，这有助于提高时钟信号的纯净度和系统稳定性，降低电磁干扰（EMI）。

复位系统包括上电复位和可重配置复位。非可重配置复位（Non-re-config reset）通常由硬件监控电路产生，用于整个系统的硬复位。可重配置复位（Re-config reset）可能通过I2C或GPIO控制，用于复位特定的逻辑区块（如FPGA）而不影响整个系统。在调试FPGA逻辑或需要局部复位时，需要区分使用。

5. 原理图与BOM使用指南

勘误文档新增了附录E和F，分别提供了Rev. 1.3载板的BOM和原理图。这是进行硬件维修、改版或深度调试的宝贵资料。

5.1 如何查阅差异表（Table F-1）

附录F中的表F-1是理解Rev. 1.2到Rev. 1.3变化的精华。它用10条清晰地概括了所有主要变更：

  1. 以太网PHY更换： Cicada换Marvell，并增加了电平转换器。所有四个端口都连接到PHY。
  2. I/O卡功能集成： 除USB外，功能移至载板。
  3. DC-DC转换器更换： RC5051M -> Belfuse SRDB-30B1AH。
  4. 时钟结构更新： 支持MPC8555E的SYSCLK和PCICLK。
  5. 时钟电源滤波： 增加了滤波电路。
  6. 移除J7连接器： 因无RoHS替代品。
  7. 更换77.76 MHz振荡器： 更新封装和供应源。
  8. BOM RoHS化： 全部物料更新为无铅型号。
  9. 增加与Arcadia的I2C通信： 用于读取FPGA版本等信息。
  10. 连接未使用的DIP开关引脚至FPGA： 为未来功能预留。

当你遇到某个功能问题时，首先应查阅此表，看是否与版本变更相关。例如，网络不通，就重点看第1、2、4条；电源问题看第3条；PCI时钟问题看第4条。

5.2 BOM与原理图交叉验证

在进行硬件维修或物料采购时：

  1. 使用正确版本的BOM： 确保你使用的是附录E（Rev. 1.3）的BOM，而不是旧版的附录C。RoHS和非RoHS的器件型号可能不同，直接替换可能导致焊接问题或可靠性下降。
  2. 通过位号（Ref Des）定位： 在原理图上找到故障元件（如损坏的电容C286），记下其位号。然后在BOM的“Ref Des”列中查找该位号，即可获得准确的器件型号、规格和数量。例如，C286在BOM中对应“CAP CER 0.01UF 50V 10% X7R 0402”。
  3. 关注特殊说明： BOM中的“Notes”列包含重要信息。例如，对于U7（一片线性开关IC），备注要求“Unsolder and lift up the IC lead of U7, pin 4 away from the pad on the PCB. Please make sure pins 3 and pin 5 of U7 is not shorted”。这显然是一个针对特定版本PCB的生产或维修工艺指令，如果不照做，可能会导致信号短路或开路。在维修时，必须严格遵守这些备注。

5.3 原理图阅读要点

CDS载板原理图庞大复杂，阅读时建议：

  1. 从封面页（Sheet 1）和模块框图（Sheet 2, 3）开始： 理解整个系统的信号流和电源分布。框图清晰地展示了处理器子卡、PCI、以太网PHY、时钟、本地总线等模块的连接关系。
  2. 关注电源树（Sheet 8, 20, 30, 32）： 理解+5V, +3.3V, +2.5V, +1.2V, +1.0V等电源是如何产生和分配的。特别是变更后的+2.5V电源（Sheet 8）。
  3. 重点阅读变更模块：
    • 以太网部分（Sheet 19-22）： 对比新旧原理图，看Marvell 88E1145的连接与Cicada CS8204有何不同，特别是RGMII接口的布线。
    • 时钟部分（Sheet 9, 10）： 查看更新后的时钟生成和分配电路。
    • 系统逻辑（Sheet 6, 7）： 了解FPGA或CPLD实现的配置逻辑、复位生成和I2C控制。
  4. 利用交叉参考： 原理图每页底部通常有“Sheet-to-sheet cross reference”，指示信号来源和去向，方便追踪信号路径。

6. 常见问题排查与实战技巧

基于对这份勘误文档的理解和实际调试经验，以下是一些典型问题及其排查思路：

问题1： 系统上电后，串口无任何输出。

  • 排查步骤：
    1. 检查电源： 测量板上关键测试点的电压（如CPU核心电压、3.3V、2.5V等）是否正常。参考原理图的电源部分。
    2. 检查复位： 测量复位信号（如HRESET,SRESET）是否在上电后从低电平跳变为高电平。
    3. 检查时钟： 使用示波器测量系统时钟（如SYSCLK、PCI_CLK）是否有波形，频率是否正确。
    4. 检查Boot配置： MPC8555E通过上拉/下拉电阻设置Boot模式（如从Flash启动还是从PCI启动）。确认配置是否正确。勘误文档未涉及此部分，需参考MPC8555E芯片手册。
    5. 检查Flash： 如果从Flash启动，检查Flash芯片的片选、读写信号是否正常。尝试重新烧写一个已知良好的U-Boot镜像。

问题2： 以太网端口无法连接，或连接速度/双工模式异常。

  • 排查步骤：
    1. 确认硬件版本： 首先确认是Configuration 1还是2。这决定了PHY型号和端口可用性。
    2. 检查PHY识别： 在U-Boot启动信息中，查看是否正确识别了PHY（Marvell 88E1145 或 Cicada CS8204）。如果显示“PHY is unknown”或类似，可能是PHY地址配置错误、MDIO总线通信失败或PHY硬件损坏。
    3. 检查接口模式：这是最高频的错误点。确认设备树（或平台代码）中的phy-connection-type属性与硬件连接完全一致（Configuration 1用gmii/mii，Configuration 2注意端口1/2用gmii，端口3/4用rgmii）。
    4. 检查RGMII���序： 如果是Configuration 2的RGMII端口问题，尝试在设备树中启用fsl,rgmii-rxid和fsl,rgmii-txid。有时需要根据实际PCB情况调整延迟值。
    5. 检查网络链路： 使用ethtool命令（Linux下）查看链路状态、自协商结果。尝试强制设置速度/双工模式看是否有效。
    6. 测量信号： 使用示波器或逻辑分析仪测量MDIO/MDC管理总线是否有波形，RGMII/TX/RX数据线是否有活动。注意阻抗匹配和信号质量。

问题3： PCI设备无法识别。

  • 排查步骤：
    1. 检查开关设置： 确认载板SW1(3)和SW2(6)已根据你的设备（PCI/PCI-X， 33/66 MHz）正确设置。
    2. 检查PCI插槽供电： 测量PCI插槽的+3.3V和+5V电源是否正常。
    3. 检查PCI复位： PCI设备的RST#信号应在系统上电后保持一段时间低电平然后变高。
    4. 查看枚举信息： 在U-Boot中使用pci命令，或在Linux中使用lspci命令，查看总线是否枚举到设备。如果总线都看不到，可能是PCI控制器未初始化或开关设置错误。
    5. 检查中断： 如果设备能识别但驱动无法工作，检查中断是否分配正确。参考勘误文档5.5.4节的中断路由表。

问题4： 系统运行不稳定，偶尔死机或数据错误。

  • 排查步骤：
    1. 检查电源完整性： 使用示波器测量核心电源和各路IO电源的纹波是否在芯片要求范围内。重点关注负载瞬变时的电压跌落。
    2. 检查时钟质量： 测量主要时钟信号的抖动和过冲/下冲。
    3. 检查散热： MPC8555E功耗不低，确保散热片安装良好，温度在允许范围内。
    4. 检查内存： 运行内存测试程序（如U-Boot中的mtest）排除内存故障。
    5. 回顾勘误中的“电源引脚滤波”： Configuration 2专门为时钟驱动器和振荡器增加了电源滤波。如果你的板子是Rev. 1.2，且时钟相关的稳定性有问题，可以考虑借鉴此设计，在时钟芯片的电源引脚附近添加去耦电容。

实战技巧：建立你自己的配置检查表面对如此复杂的硬件，最好的方法是根据你的具体版本（Config 1或2），从这份勘误文档中提炼出关键设置项，制作一份属于自己的硬件配置检查表（Checklist）。表格可以包含以下列：配置项（如SW1(3)）、Config 1设置、Config 2设置、我的板子实际设置、备注。每次动硬件或调试新功能前都核对一遍，能极大减少因配置错误导致的调试时间浪费。这份勘误文档本身就是制作这份检查表最权威的输入。

http://www.zskr.cn/news/1523478.html

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